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200 |
1 |
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|a Logique programmable
|e architecture des FPGA et CPLD, méthodes de conception, le langage VHDL
|f Laurent Dutrieux, Didier Demigny
|g préface de Laurent Bathellier
|g ouvrage coordonné par Carl Conrad
|
214 |
|
0 |
|a Paris
|c Eyrolles
|d DL 1997
|
215 |
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|
|a 1 vol. (VII-234 p.)
|c ill., couv. ill. en coul.
|d 23 cm
|
300 |
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|a FPGA = Field programmable gate array. CPLD = Complex programmable logic device. VHDL = VHSIC hardware description language. VHSIC = Very high speed integrated circuits
|
320 |
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|
|a Bibliogr. p. [233]-234. Index
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606 |
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|3 PPN031864112
|a Circuits intégrés numériques
|x Conception et construction
|x Informatique
|2 rameau
|
606 |
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|
|3 PPN034756957
|a Réseaux logiques programmables par l'utilisateur
|2 rameau
|
606 |
|
|
|3 PPN028111877
|a Logique du premier ordre
|3 PPN027241408
|x Logiciels
|2 rameau
|
606 |
|
|
|3 PPN027672670
|a Réseaux logiques programmables
|2 rameau
|
606 |
|
|
|3 PPN031864155
|a VHDL (langage de description de matériel informatique)
|2 rameau
|
675 |
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|a 67
|v Éd. 1967
|
676 |
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|a 670
|
680 |
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700 |
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1 |
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|a Dutrieux
|b Laurent
|4 070
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701 |
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1 |
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|a Demigny
|b Didier
|f 1958-....
|4 070
|
702 |
|
1 |
|3 PPN122604288
|a Bathellier
|b Laurent
|4 080
|
702 |
|
1 |
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|a Conrad
|b Carl
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1 |
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|
801 |
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2 |
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801 |
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3 |
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|g AFNOR
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801 |
|
3 |
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|g AFNOR
|
801 |
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3 |
|a FR
|b Abes
|c 20191030
|g AFNOR
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979 |
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979 |
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|a exemplaire créé automatiquement par l'ABES
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|a Exemplaire modifié automatiquement. le 23-01-2023 15:57
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