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| LEADER |
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|b br.
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|b DL 01-05759 (D3)
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| 033 |
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| 035 |
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|9 sudoc
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| 035 |
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|9 sudoc
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|
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|
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| 100 |
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|
| 101 |
1 |
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|c eng
|2 639-2
|
| 102 |
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| 105 |
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|
| 106 |
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|a r
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| 181 |
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|
| 181 |
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1 |
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|
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|
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|
| 182 |
|
1 |
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|
| 183 |
|
|
|6 z01
|a nga
|2 RDAfrCarrier
|
| 200 |
1 |
|
|a Architecture de l'ordinateur
|e cours et exercices
|f Andrew Tanenbaum
|g avec la contribution de James Goodman
|g texte français de Jean-Alain Hernandez & René Joly
|
| 205 |
|
|
|a 4e édition
|
| 214 |
|
0 |
|a Paris
|c Dunod
|
| 214 |
|
4 |
|d C 2001
|
| 215 |
|
|
|a 1 vol. (XIV-638 p.)
|c ill., couv. ill. en coul.
|d 25 cm
|
| 225 |
2 |
|
|a Sciences sup
|
| 305 |
|
|
|a Autre(s) tirage(s) : 2002
|
| 320 |
|
|
|a Bibliogr. p. [625]-628. Index. Glossaire
|
| 333 |
|
|
|a 2e cycle. Écoles d'ingénieurs
|
| 359 |
2 |
|
|b Chapitre 1. Introduction
|c 1.1 L'architecture en couches
|c 1.2 Les grandes étapes de l'architecture des ordinateurs
|c 1.3 Le zoo de l'informatique
|c 1.4 Trois familles d'ordinateurs
|c 1.5 Plan de l'ouvrage
|b Chapitre 2. Structure d'un ordinateur
|c 2.1 Le processeur ou unité centrale
|c 2.2 La mémoire principale
|c 2.3 Les mémoires secondaires
|c 2.4 Les entrées/sorties
|c 2.5 Résumé
|b Chapitre 3. La couche physique
|c 3.1 Portes logiques et algèbre de Boole
|c 3.2 Circuits logiques de base
|c 3.3 Circuits logiques à mémoire
|c 3.4 Les microprocesseurs et les bus
|c 3.5 Exemples de microprocesseurs
|c 3.6 Exemples de bus
|c 3.7 Technique d'interfaçage
|c 3.8 Résumé
|b Chapitre 4. La couche microarchitecture
|c 4.1 Un exemple de microarchitecture : la Mic-1
|c 4.2 Un exemple de macroarchitecture : l'IJVM
|c 4.3 Un exemple d'implémentation
|c 4.4 Conception de la microarchitecture
|c 4.5 Amélioration des performances
|c 4.6 Exemples de microarchitectures
|c 4.7 Résumé
|b Chapitre 5. La couche ISA
|c 5.1 Synthèse de la couche ISA
|c 5.2 Types de données
|c 5.3 Format des instructions
|c 5.4 L'adressage
|c 5.5 Types d'instructions
|c 5.6 Flux de commande
|c 5.7 Exemples de programmes en assembleur : les tours de Hanoï
|c 5.8 L'architecture Intel IA-64
|c 5.9 Résumé
|b Chapitre 6. La couche système d'exploitation
|c 6.1 Mémoire virtuelle
|c 6.2 Les instructions d'E/S virtuelles
|c 6.3 Les instructions virtuelles dans le calcul parallèle
|c 6.4 Exemples de systèmes d'exploitation
|c 6.5 Résumé
|b Chapitre 7. La couche langage d'assemblage
|c 7.1 Introduction au langage d'assemblage
|c 7.2 Les macros
|c 7.3 Le processus d'assemblage
|c 7.4 Éditeur de liens et chargeur
|c 7.5 Résumé
|b Chapitre 8. Architectures des ordinateurs parallèles
|c 8.1 Tour d'horizon des ordinateurs parallèles
|c 8.2 Les ordinateurs SIMD
|c 8.3 Les multiprocesseurs à mémoire partagée
|c 8.4 Les multiordinateurs à transfert de messages
|c 8.5 Résumé
|b Annexe A. Numération binaire
|b Annexe B. Nombres en virgule flottante
|c Annexe C. Lexique
|
| 410 |
|
| |
|0 013680803
|t Sciences sup
|x 1636-2217
|
| 454 |
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| |
|t Structured computer oganization
|e 4th edition
|c Englewood Cliffs (N.J.)
|n Prentice-Hall
|d cop. 1999
|
| 606 |
|
|
|3 PPN027269787
|a Architecture des ordinateurs
|3 PPN03020934X
|x Manuels d'enseignement supérieur
|2 rameau
|
| 606 |
|
|
|3 PPN027269787
|a Architecture des ordinateurs
|3 PPN027790517
|x Problèmes et exercices
|2 rameau
|
| 675 |
|
|
|a 67
|v Éd. 1967
|
| 676 |
|
|
|a 004.22
|
| 680 |
|
|
|a QA76.9.A73
|
| 700 |
|
1 |
|3 PPN028809971
|a Tanenbaum
|b Andrew
|f 1944-....
|4 070
|
| 702 |
|
1 |
|3 PPN055382932
|a Goodman
|b James
|4 205
|
| 702 |
|
1 |
|3 PPN026920379
|a Hernandez
|b Jean-Alain
|4 730
|
| 702 |
|
1 |
|3 PPN028137701
|a Joly
|b René
|f 1948-....
|4 730
|
| 801 |
|
3 |
|a FR
|b Abes
|c 20210908
|g AFNOR
|h 055124852
|
| 801 |
|
3 |
|a FR
|b Abes
|c 20210908
|g AFNOR
|h 054261546
|
| 801 |
|
1 |
|a US
|b OCLC
|g AACR2
|
| 801 |
|
2 |
|a FR
|b AUROC
|g AFNOR
|
| 801 |
|
3 |
|a FR
|b SF
|g AFNOR
|
| 801 |
|
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|g AFNOR
|
| 979 |
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| 979 |
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|
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|a Exemplaire créé en masse par ITEM. le 18-01-2024 11:25
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|
Nantilus
